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31.

A Low-Noise and Small-Size DC Reference Circuit for High Speed CMOS A/D Converters

Hwang. Sang-Hoon, Song. Min-Kyu 대한전자공학회 Journal of semiconductor technology and science 8 Pages

대한전자공학회 Journal of semiconductor technology and science 2007, Vol.7 No.1 43-50 (8 pages)

Hwang. Sang-Hoon, Song. Min-Kyu 저

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32.

고온 초전도 RSFQ A/D 변환기의 시물레이션과 설계

남두우, 정구락, 강준희 한국초전도저온공학회 한국초전도·저온공학회논문지 5 Pages

한국초전도저온공학회 한국초전도·저온공학회논문지 2002, Vol.4 No.1 8-12 (5 pages)

남두우, 정구락, 강준희 저

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33.

DLL 기반의 듀티 보정 회로를 적용한 무선랜용 I/Q 채널 12비트 40MS/s 파이프라인 A/D변환기

이재용, 조성일, 박현묵, 이상민, 윤광섭, Lee. Jae-Yong, Cho. Sung-Il, Park. Hyun-Mook, Lee. Sang-Min, Yoon. Kwang-Sub 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 8 Pages

한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 2008, Vol.33 395-402 (8 pages)

이재용, 조성일, 박현묵, 이상민, 윤광섭, Lee. Jae-Yong, Cho. Sung-Il, Park. Hyun-Mook, Lee. Sang-Min, Yoon. Kwang-Sub 저

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수 있도록 I/Q 채널 12비트 40MS/s 파이프라인 아날로그-디지털 변환기를 제안하였다. 제안하는 A/D 변환기는 높아진 동작 속도와 CMOS 소자의 최소 선폭이 작아지며 생기는 듀티 사이클의 변화를 보정해 줄 수 있는 DLL 기반의 듀티 사이클 보정 회로를 집적화 하였다. 입력 듀티 사이클이 1%에서 99%까지 변동이 있어도 정확한 50%의 듀티 사이클을 가진 신호로 보정 가능하도록 설계하였다. 제작된 A/D 변환기는 $0.18{mu}m$ CMOS n-well 1-poly 6-metal 공정으로 제작되었으며, 전력 소모는 1.8V 전원 전압에서 184mW이다. 샘플링 및...
34.

Verilog-A를 이용한 파이프라인 A/D변환기의 모델링

박상욱, 이재용, 윤광섭, Park. Sang-Wook, Lee. Jae-Yong, Yoon. Kwang-Sub 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 6 Pages

한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 2007, Vol.32 1019-1024 (6 pages)

박상욱, 이재용, 윤광섭, Park. Sang-Wook, Lee. Jae-Yong, Yoon. Kwang-Sub 저

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본 논문에서는 무선 랜 시스템용 10비트 20MHz 파이프라인 아날로그-디지털 변환기 설계를 위해서 Verilog-A 언어를 사용하여서 모델링하였다. 변환기내 샘플 / 홀드 증폭기, 비교기, MDAC 및 오차 보정 회로 등의 구성회로들을 각각 모델링해서 모의실험 한 결과 HSPICE를 이용한 모의 실험 시간보다 1/50배로 단축되어서 시스템 모델링에 적합함을 확인하였다.
35.

${sum}-{Delta}$ modulator의 구조를 갖는A/D 변환기 설계

윤정식, 정정화 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 10 Pages

한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 2003, Vol.28 14-23 (10 pages)

윤정식, 정정화 저

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두 가지 특성으로 인해 낮은 해상도의 A/D 변환기와 결합하여 높은 해상도를 갖는 A/D 변환기의 구현이 가능하다는 장점으로 audio 응용 분야에 널리 사용되어 왔다. 그러나, Sigma-delta modulator를 무선 데이터 통신 등 다양한 응용 분야에서 사용하기 위해서는 좀더 높은 데이터 rate를 갖는 Sigma-delta modulator에 관한 연구가 필요하게 되었다. 본 논문에서 제안한 Sigma-delta modulator 구조는 기존의 64 내지 256의 oversampling비를 16으로 낮추어 sampling을 하여 기존의 수 십에서 수 백 Ks/s정도의 데이터 rate를 1 Ms/s...
36.

12비트 CMOS 전류 셀 매트릭스 D/A 변환기 설계

류기홍, 윤광섭, Ryu. Ki-Hong, Yoon. Kwang-Sub 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 12 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1999, No.0 10-21 (12 pages)

류기홍, 윤광섭, Ryu. Ki-Hong, Yoon. Kwang-Sub 저

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CMOS D/A 변환기를 제안하였다. 설계된 CMOS D/A 변환기는 우수한 단조증가성과 빠른 정착시간을 가지는 전류 셀 매트릭스 구조의 장점을 이용하면서 기존의 D/A 변환기의 전류셀 간의 문턱전압의 부정합과 접지선의 전압 강하에 의한 오차를 감소시키기 위해 트리 구조 바이어스 회로, 대칭적 접지선 연결, 캐스코드 전류 스위치를 사용하여 구현되었다. 설계된 전류 셀 매트릭스 12비트 D/A 변환기를 $0.6{mu}m$ CMOS n-well 공정을 이용하여 제작하였다. 제작된 DAC칩을 +3.3V 단일 공급전원을 이용하여 측정한 결과, 정착시간이...
37.

2단 전류셀 매트릭스 구조를 지닌 저전압 고속 8비트 CMOS D/A 변환기

김지현, 권용복, 윤광섭 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 10 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1998, No.0 50-59 (10 pages)

김지현, 권용복, 윤광섭 저

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38.

높은 선형성을 가진 3 V 10b 영상 신호 처리용 CMOS D/A 변환기 설계

이성훈, 전병렬, 윤상원, 이승훈 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 9 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1997, No.0 28-36 (9 pages)

이성훈, 전병렬, 윤상원, 이승훈 저

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39.

WLAN용 10bit 210MHz CMOS D/A 변환기 설계

조현호, 윤광섭, Cho. Hyun-Ho, Yoon. Kwang-Sub 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 6 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 2005, Vol.42 No.11 61-66 (6 pages)

조현호, 윤광섭, Cho. Hyun-Ho, Yoon. Kwang-Sub 저

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CMOS 전류구동 디지털-아날로그 데이터 변환기(DAC)을 설계하였다. 제안된 새로운 글리치 억제회로는 입력된 신호의 교차되는 위치를 조절함으로써, 글리치 에너지를 최소화하도록 설계하였다. 또한 제안된 10비트 DAC는 CMOS $0.35{mu}m$ 2-poly 4-metal 공정을 이용하여 설계하였으며, 유효 칩 면적은 5mm2이다. 제안된 10비트 DAC 칩의 측정결과, 변환속도는 210MHz, DNL/INL은 각각 ${pm}0.7LSB/{pm}1.1LSB$이며, 글리치 에너지는 $76pV{cdot}sec$이고, SNR은 50dB, SFDR은 53dB((a)200MHz), 전력소비는 83mW((a)3.3V)로 측정되었다.
40.

슈도-세그멘테이션 기법을 이용한 저 전력 12비트 80MHz CMOS D/A 변환기 설계

주찬양, 김수재, 이상민, 강진구, 윤광섭, Joo. Chan-Yang, Kim. Soo-Jae, Lee. Sang-Min, Kang. Jin-Ku, Yoon. Kwang-Sub 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2008, Vol.45 No.4 13-20 (8 pages)

주찬양, 김수재, 이상민, 강진구, 윤광섭, Joo. Chan-Yang, Kim. Soo-Jae, Lee. Sang-Min, Kang. Jin-Ku, Yoon. Kwang-Sub 저

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본 논문에서는 무선 통신 응용 시스템에 적합하도록 슈도-세그멘테이션 기법을 이용하여 저 전력 12비트 80MHz D/A 변환기를 CMOS 0.18um n-well 1-Poly/6-Metal 공정으로 설계하였다. 슈도-세그멘테이션 기법은 간단한 병렬 버퍼로 구성된 이진 디코더를 사용함으로써 구조적으로 간단해지며 저 전력으로 구현이 가능하다. 또한, 스위칭 코어 회로에 글리치 억제 회로와 입력신호의 스윙을 감소시키는 구동 회로를 설계함으로써 추가적인 스위칭 잡음을 줄일 수 있었다. 측정 결과 제안한 저 전력 12bit 80MHz CMOS D/A 변환기는 샘플링...

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