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81.

상용 응용을 위한 병렬처리 구조 설계

한우종, 윤석한, 임기욱 대한전자공학회 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B 11 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B 1996, No.0 41-51 (11 pages)

한우종, 윤석한, 임기욱 저

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82.

병렬 파이프라인 프로세서 아키덱처의 설계

이상정, 김광준 대한전자공학회 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B 13 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B 1995, No.0 11-23 (13 pages)

이상정, 김광준 저

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83.

대규모 병렬컴퓨터를 위한 교차메쉬구조 및 그의 성능해석

김종진, 최흥문 대한전자공학회 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B 10 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korea institute of telematics and electronics. B 1995, No.0 720-729 (10 pages)

김종진, 최흥문 저

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84.

A LDPC Decoder for DVB-S2 Standard Supporting Multiple Code Rates

류혜진, 이종열, Ryu. Hye-Jin, Lee. Jong-Yeol 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 7 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2008, Vol.45 No.2 118-124 (7 pages)

류혜진, 이종열, Ryu. Hye-Jin, Lee. Jong-Yeol 저

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디지털 비디오 방송표준(DVB-S2)은 순방향 에러 코딩방법으로 BCH와 LDPC을 연결한 시스템을 내부코딩으로 사용한다. DVB-S2에서 LDPC 코드는 11개의 서로 다른 부호화 율을 정의하고 있기 때문에, DVB-S2 LDPC 복호기는 다양한 부호화 율을 지원해야 한다. 11개의 부호화 율 중에서 7가지(3/5, 2/3, 3/4, 4/5, 5/6, 8/9, 9/10)는 균일한 부호화 율이고, 나머지 4가지(1/4, 1/3, 2/5, 1/2)는 비균일 부호화 율이다. 본 논문에서는 균일한 LDPC 코드를 위한 유연한 복호기를 제시한다. 제안된 복호기는 칩의 면적, 메모리의 효율, 처리속도...
85.

Multi-band OFDM 시스템용 고속 연판정 비터비 디코더의 효율적인 하드웨어 구조 설계에 관한 연구

이성주, Lee. Seong-Joo 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2006, Vol.43 No.11 90-97 (8 pages)

이성주, Lee. Seong-Joo 저

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본 논문에서는 Multi-band OFDM(MB-OFDM) 시스템에 적합한 고속 연판정 비터비 디코더의 효율적인 하드웨어 구조에 대해서 제시한다. MB-OFDM 시스템은 최대 480Mbps의 데이터 속도를 처리해야 하고 시스템 클럭으로 528MHz가 제공되기 때문에, 설계의 신뢰도를 향상시키기 위해 병렬처리 구조를 사용한다. 따라서, 비터비 디코더도 여러 개의 데이터를 동시에 처리하는 병렬처리 구조를 지원해야 하며, 또한 고속의 데이터를 처리하기 위한 하드웨어 구조를 사용해야 한다. 본 논문에서는 4-way 병렬처리에 적합하면서도 동시에 하드웨어...
86.

Homogeneous Transformation Matrix의 곱셈을 위한 병렬구조 프로세서의 설계

권두올, 정태상, Kwon. Do-All, Chung. Tae-Sang 대한전기학회 전기학회논문지. The transactions of the Korean Institute of Electrical Engineers. D / D, 시스템 및 제어부문 9 Pages

대한전기학회 전기학회논문지. The transactions of the Korean Institute of Electrical Engineers. D / D, 시스템 및 제어부문 2005, Vol.54 No.12 723-731 (9 pages)

권두올, 정태상, Kwon. Do-All, Chung. Tae-Sang 저

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87.

병렬 처리 구조 터보 부호에서 라틴 방진 행렬로 구성된 충돌 방지 인터리버

김대선, 오현영, 송홍엽, Kim. Dae-Son, Oh. Hyun-Young, Song. Hong-Yeop 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 6 Pages

한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 2008, Vol.33 161-166 (6 pages)

김대선, 오현영, 송홍엽, Kim. Dae-Son, Oh. Hyun-Young, Song. Hong-Yeop 저

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병렬 처리 구조 터보 부호에서 메모리 충돌을 피하기 위한 구성 인터리버 설계가 필요하다. 본 논문에서는 기존에 설계된 인터리버들과 라틴 방진 행렬로 구성된 충돌 방지 인터리버를 제안한다. 제안된 인터리버는 다양한 블록 길이와 다양한 병렬 처리 차수에 대하여 쉽게 최적화 할 수 있다. 제안된 인터리버의 성능을 컴퓨터 모의실험을 통해 검증하였다.
88.

처리기에 지역 버퍼 메모리 시스템을 지원하는 다중접근기억장치

이형, Lee. Hyung 한국콘텐츠학회 한국콘텐츠학회논문지 8 Pages

한국콘텐츠학회 한국콘텐츠학회논문지 2012, Vol.12 No.1 30-37 (8 pages)

이형, Lee. Hyung 저

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선형 비틀림 구조를 갖는 메모리 시스템은 SIMD 구조에 적합한 메모리 시스템으로써, 2차원 데이터 배열인 $M{ imes}N$에서 임의의 위치로부터 임의의 간격을 갖고 다양한 접근형태들로, m개의 메모리 모듈들에서 n개의 데이터를 동시에 접근할 수 있다. 그러나 이러한 메모리 시스템은 논리적인 2차원 $M{ imes}N$ 데이터 배열을 지원하기 위해 $m{ imes}cells$의 물리적인 메모리 용량이 필요하지만, 적어도 (m-n)${ imes}cells$만큼의 메모리 셀은 사용되지 않는다. 여기서 cells는 (M-1)/q+(N-1)/$p{ imes}{lceil}M/q{ ceil}+1$이다....
89.

독립적 홀로그램 화소 연산 방식의 고성능 디지털 홀로그램 생성기의 하드웨어 구조

이윤혁, 서영호, 최현준, 김동욱, Lee. Yoon-Huyk, Seo. Young-Ho, Choi. Hyun-Jun, Kim. Dong-Wook 한국방송공학회 방송공학회논문지 13 Pages

한국방송공학회 방송공학회논문지 2011, Vol.16 No.3 403-415 (13 pages)

이윤혁, 서영호, 최현준, 김동욱, Lee. Yoon-Huyk, Seo. Young-Ho, Choi. Hyun-Jun, Kim. Dong-Wook 저

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본 논문에서는 고속으로 디지털 홀로그램을 생성할 수 있는 하드웨어구조를 제안하였다. 수정된 컴퓨터 생성 홀로그램(computer-generated hologram, CGH) 알고리즘을 이용하고, 기존의 한 화소에 대한 홀로그램 전체 화소를 연산하는 방법이 아니라 객체 전체 화소에서 홀로그램의 한 화소씩 연산하는 방법을 선택하여 홀로그램 한 화소씩 계산하고 바로 출력 하여 메모리 병목 현상을 제거하기 위한 파이프라인 기반의 하드웨어 구조를 제안하였다. CGH 알고리즘을 바탕으로 입력부, 연산부, 및 정규화부로 구성된 디지털 홀로그램...
90.

고성능 H.264/AVC 디블로킹 필터를 위한 4-병렬 스케줄링 아키텍처

고병수, 공진흥, Ko. Byung-Soo, Kong. Jin-Hyeung 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2012, Vol.49 No.8 63-72 (10 pages)

고병수, 공진흥, Ko. Byung-Soo, Kong. Jin-Hyeung 저

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본 연구에서는 Quad FHD의 고해상도 동영상을 실시간 처리하는 고성능 H.264/AVC 디블로킹필터를 설계하였다. 연산처리 성능을 향상시키기 위해 라인에지필터 16개를 4개의 블록에지필터로 병렬 설계하였으며, 내부버퍼 크기와 연산 사이클을 줄이기 위해 H.264/AVC 디블로킹 필터 순서를 4단 병렬 지그재그 스캔 순서로 스케줄링하였다. 그리고 블록에지필터 연산 간 1사이클의 지연시간을 두어 데이터 충돌을 방지하고, 블록에지필터 간 내부버퍼를 인터리빙 버퍼로 구현하여 내부버퍼 크기를 줄였다. 0.18um 공정에서 시뮬레이션한...

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