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A CMOS Duty Cycle Corrector Using Dynamic Frequency Scaling for Coarse and Fine Tuning Adjustment
한상우, 김종선, Han. Sangwoo, Kim. Jongsun 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 6 Pages
대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2012, Vol.49 No.10 142-147 (6 pages)
본 논문에서는 다이나믹 주파수 스케일링 (DFS) 카운터를 사용하여 코오스, 파인 조정 기능을 갖는 CMOS 듀티 사이클 보정회로를 제시한다. DFS 카운터는 디지털-아날로그 컨버터의 비트 스위칭 글리치를 감소시키기 때문에 제안하는 CMOS 듀티 사이클 보정회로의 듀티 보정 범위를 증가시키고 지터 특성을 개선한다. 제안하는 회로는 0.18-${mu}m$ CMOS 공정을 이용하여 설계되었다. 0.5-1.5GHz의 넓은 동작 주파수와 25-75%의 넓은 듀티 사이클 보정 범위 내에서 측정된 최대 출력 듀티 사이클 에러는 ${pm}1.1%$이다. -
고속 SoC를 위한 클락 듀티 보정회로의 설계
한상우, 김종선, Han. Sang Woo, Kim. Jong Sun 한국산업정보학회 한국산업정보학회논문지 8 Pages
한국산업정보학회 한국산업정보학회논문지 2013, Vol.18 No.5 51-58 (8 pages)
(Duty-Cycle Corrector: DCC)를 소개한다. 종래의 아날로그 피드백 DCC와 디지털 피드백 DCC의 구조와 동작에 대해 비교 분석한다. 듀티-보정 레인지의 확장과 동작 주파수 및 듀티-보정 정확도의 향상을 위해 아날로그와 디지털 DCC의 장점을 결합한 새로운 혼성-모드 피드백 DCC를 소개한다. 특히, 혼성-모드 DCC의 핵심 구성 회로인 듀티-앰프 (Duty-Cycle Amplifier: DCA)의 구조와 설계에 대해 자세히 소개한다. 싱글-스테이지 DCA와 투-스테이지 DCA 기반의 두 개의 혼성-모드 DCC가 각각 0.18-${mu}m$ CMOS 공정으로 설계되었고,...