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Field-Programmable Gate Array를 사용한 탭 딜레이 방식 시간-디지털 변환기의 정밀도 향상에 관한 연구
정도환, 임한상, Jung. Do-Hwan, Lim. Hansang 대한전자공학회 Journal of the Institute of Electronics and Information Engineers 8 Pages
대한전자공학회 Journal of the Institute of Electronics and Information Engineers 2014, Vol.51 No.9 182-189 (8 pages)
탭 딜레이(tapped delay) 방식은 field-programmable gate arrary(FPGA) 내부 리소스를 이용한 설계에 적합하여 FPGA기반 시간-디지털 변환기(time-to-digital converter)로 널리 사용되고 있다. 그런데 이 방식의 시간-디지털 변환기에서는 지연 소자로 사용하는 전용 캐리체인(dedicated carry chain)의 탭 당 지연시간 차이가 정밀도 저하의 가장 큰 원인이 되고 있다. 본 논문에서는 일반적인 구형파 대신 고정된 시간 폭을 가지는 펄스신호를 지연 소자로 인가하고 상승과 하강 엣지에서 두 번의 시간 측정을 통해 전용 캐리체인내... -
HPD 개발수명주기를 적용한 원전 FPGA 기반 제어기의 설계와 검증
이준구, 정광일, 박근옥, 손광영, Lee. Joon-Ku, Jeong. Kwang-Il, Park. Geun-Ok, Sohn. Kwang-Young 한국전자통신학회 한국전자통신학회 논문지 7 Pages
한국전자통신학회 한국전자통신학회 논문지 2014, Vol.9 No.6 681-687 (7 pages)
있으며, 이러한 문제를 근본적으로 해결하고자 노력하고 있다. IAEA, IEC, 등의 연구결과에 따르면, FPGA는 단종이 예상되는 제어계통에의 대체수단으로 주목받고 있다. FPGA가 원자력 플랜트의 PLC(Programmable Logic Controller)를 대체하기 위해서는 높은 건정성과 신뢰성을 가져야 한다. 따라서, FPGA 기반 제어기의 건전성과 신뢰성을 향상시키기 위하여 HDL 개발수명주기를 적용하여 개발하였다. 또한, 원전 계측제어계통에 적용하기 위하여 번인시험과 환경시험의 기기검증이 수행되었다. 시험수행결과, 352시간의 번인시험과...