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An Analytical Evaluation of 2D Mesh-connected SIMD Architecture for Parallel Matrix Multiplication
김정길, Kim. Cheong-Ghil 한국정보통신설비학회 정보통신설비= Journal of information and telecommunication facility engineering 7 Pages
한국정보통신설비학회 정보통신설비= Journal of information and telecommunication facility engineering 2011, Vol.10 No.1 7-13 (7 pages)
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MediaFrame: Parallel multimedia system architecture through HTTP redirection
김성기, 한상영, Kim. Seong-Ki, Han. Sang-Yong 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 10 Pages
한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2007, No.0 15-24 (10 pages)
한 대의 비디오 서버가 확장성, 용량, 고장 감내(Fault-tolerance), 비용 효율성(Cost-efficiency)에서 한계들을 드러냄에 따라 해결책들이 나타났다. 그러나, 이러한 해결책들도 각각의 문제점들을 지닌다. 우리는 이러한 문제점들을 해결하고 다양한 비디오 서버들을 활용하기 위해, HTTP 레벨 리디렉션(Redirection)을 통하여 이질적인 퍼스널 컴퓨터(Personal Computer), 운영 체제(Operating System) 비디오 서버들로 내용에 따른 라우팅(Routing)을 지원하는 병렬 멀티미디어 시스템 구조를 디자인하였다. 또한 프로토타입을... -
An FPGA-based Parallel Hardware Architecture for Real-time Eye Detection
Kim. Dong-Kyun, Jung. Jun-Hee, Nguyen. Thuy Tuong, Kim. Dai-Jin, Kim. Mun-Sang, Kwon. Key-Ho, Jeon. Jae-Wook 대한전자공학회 Journal of semiconductor technology and science 12 Pages
대한전자공학회 Journal of semiconductor technology and science 2012, Vol.12 No.2 150-161 (12 pages)
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Feed forward Differential Architecture of Analog Parallel Processing Circuits for Analog PRML Decoder
마헤스워 샤퍄라, 양창주, 김형석, Sah. Maheshwar Pd., Yang. Chang-Ju, Kim. Hyong-Suk 대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 8 Pages
대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 2010, Vol.59 No.8 1489-1496 (8 pages)
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Three-Parallel Reed-Solomon based Forward Error Correction Architecture for 100Gb/s Optical Communications
최창석, 이한호, Choi. Chang-Seok, Lee. Han-Ho 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2009, Vol.46 No.11 48-55 (8 pages)
본 논문에서는 차세대 100-Gb/s급 광통신 시스템을 위한 3-병렬 Reed-Solomon (RS) 디코더 기반의 고속 Forward Error Correction (FEC) 구조를 제안한다. 제안된 16채널 RS기반 FEC 구조는 4개의 신드롬 계산 블록이 1개의 Key Equation Solver (KES) 블록을 공유하는 3-병렬 4채널 RS 기반 FEC 구조 4개로 구성되어 있다. 제안하는 100-Gb/s RS 기반 FEC는 1.2V의 공급전압의 $0.13{mu}m$ CMOS 공정을 이용하여 구현하였다. 구현 결과 제안된 RS기반 FEC 구조는 300MHz의 동작 주파수에서 115-Gb/s 의 데이터 처리율을 가지며, 기존의...