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Mobile Application을 위한 All Digital Phase-Locked Loop 연구 동향
신재욱, 신현철, Sin. Jae-Uk, Sin. Hyeon-Cheol 한국통신학회 정보와 통신 : 한국통신학회지 7 Pages
한국통신학회 정보와 통신 : 한국통신학회지 2011, Vol.28 No.11 9-15 (7 pages)
CMOS 집적회로기술의 발달로 인해 디지털회로는 속도향상 소모전력 감소로 성능이 매우 많이 향상되었지만, Analog/RF 회로는 동작전압감소, 공정변화심화 등으로 인해 심각한 성능저하가 나타나고 있다. 이에 기존의 전하펌프 기반 아날로그 PLL에 대한 대안으로 All Digital PLL(ADPLL)이 개발되고 이미 상용제품에 적용되고 있다. 하지만 그 성능은 데이터변환 회로인 TDC와 DCO의 제한된 해상도로 인해 개선이 많이 필요하다. 이 두 회로는 ADPLL의 성능에 가장 큰 영향을 미치므로 본 논문에서는 지금까지 발표된 TDC와 DCO... -
A 1.8 V 0.18-μm 1 GHz CMOS Fast-Lock Phase-Locked Loop using a Frequency-to-Digital Converter
Lee. Kwang-Hun, Jang. Young-Chan 한국정보통신학회 Journal of information and communication convergence engineering 7 Pages
한국정보통신학회 Journal of information and communication convergence engineering 2012, Vol.10 No.2 187-193 (7 pages)
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반도체 VCO Laser의 주파수 응답 특성이 Optical Phase-Locked Loop 성능에 미치는 영향
오세은, 최우영, O. Se-Eun, Choi. Woo-Young 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. D 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. D 1999, No.0 71-78 (8 pages)
본 논문에서는 마이크로웨이브 대역의 OPLL 해석시 루프 시간 지연뿐만 아니라 기존의 연구에서는 고려하지 않았던 반도체 VCO laser의 주파수 응답을 모델링하여 OPLL의 성능에 미치는 영향을 분석하였다. 루프 시간 지연은 시스템의 안정성과 레이저의 최대 허용 선폭에 대한 조건을 더욱 엄격하게 함을 확인할 수 있었다. 또한 VCO laser의 주파수 응답을 고려할 경우 레이저의 최대 허용 선폭을 최적화된 값으로 설정할 수 있음을 확인할 수 있었다. 따라서, 대역폭이 큰 OPLL을 설계할 경우에는 루프 시간 지연뿐만 아니라 VCO... -
Tracking analog-to-digital 변환기를 이용한 digital phase-locked loop
차수호, 유창식, Cha. Soo-Ho, Yoo. Chang-Sik 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 6 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2005, Vol.42 No.9 35-40 (6 pages)
본 논문에서는 1.6Gb/s에서 동작하는 digitally controlled phase-locked loop (DCPLL)를 제안한다. DCPLL은 일반적인 아날로그 PLL과 tracking analog-to-digital 변환기를 결합한 구조이다. 제안한 DCPLL에서는 tracking ADC의 출력이 voltage controlled oscillator (VCO)의 제어 전압을 생성한다. 일반적으로 사용되는 digital PLL (DPLL)은 digitally controlled oscillator (DCO)와 time-to-digit converter (TDC)로 구성된다 DCO와 TDC를 사용한 DPLL은 시간 스텝이 작을 수 록 jitter 특성이 향상되지만 전력소모는 커진다. 이...