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Design of a 6-bit 500MS/s CMOS A/D Converter with Comparator-Based Input Voltage Range Detection Circuit
시대, 이상민, 윤광섭, Dai. Shi, Lee. Sang Min, Yoon. Kwang Sub 한국통신학회 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신 7 Pages
한국통신학회 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신 2013, No.0 303-309 (7 pages)
입력 전압 범위 감지 회로를 이용해서 저전력 6비트 플래시 500Ms/s ADC를 설계하였다. 입력 전압 범위 감지 회로는 변환기내 모든 비교기들 중에서 25%만 동작시키고, 나머지 75%는 동작시키지 않는 방법을 채택하므로 저전력 동작을 가능하게 설계 및 제작하였다. 설계된 회로는 0.13um CMOS 공정기술을 이용해서 제작하였고, 1.2V 전원전압에서 68.8mW 전력소모, 4.9 유효 비트수, 4.75pJ/step의 평가지수가 측정되었다. -
자체보정 벡터 발생기를 이용한 7-bit 2GSPS A/D Converter의 설계
김승훈, 김대윤, 송민규, Kim. Seung-Hun, Kim. Dae-Yun, Song. Min-Kyu 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2011, Vol.48 No.4 14-23 (10 pages)
발생기(Self-Calibrated Vector Generator)를 이용한 7-bit 2GSPS folding/interpolation A/D Converter (ADC)를 제안한다. 제안하는 ADC는 2GSPS 의 고속 변환에 적합한 상위 2-bit, 하위 5-bit 인 분할구조로 설계 되었으며, 각각의 folding/interpolation rate는 4와 8로 설정되었다. 최대 1GHz의 높은 입력신호를 처리하기 위해 cascade 구조의 preprocessing block을 적용하였으며, 전압 구동 방식 interpolation 기법을 적용하여 기준전압 생성 시 발생하는 추가적인 전력소모를 최소화하였다. 또한, 새로운 개념의 자체보정 벡터... -
Interpolation 기법을 이용한 3.3V 8-bit 500MSPS Nyquist CMOS A/D Converter의 설계
김상규, 송민규 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2004, Vol.41 No.8 67-74 (8 pages)
이 논문에서는 Interpolation 구조를 이용한 3.3V 8-bit 500MSPS CMOS A/D 변환기를 설계하였다. 고속 동작의 문제를 해결하기 위해서 새로운 프리앰프, 기준 전압 흔들림을 보정하기 위한 회로, 평균화 저항을 제안하였다. 제안된 Interpolation A/D 변환기는 Track ＆ Hold, 256개의 기준전압이 있는 4단 저항열, 128개의 비교기 그리고 디지털 블록으로 구성되어 있다. 제안된 A/D 변환기는 0.35um 2-poly 4-metal N-well CMOS 공정이다. 이 A/D 변환기는 3.3V에서 440mW를 소비하며, 유효 칩 면적은 2250um x 3080um을 갖는다. -
VFC type A/D Converter에 관한 연구
김춘성, 이종각 대한전자공학회 電子工學會誌 4 Pages
대한전자공학회 電子工學會誌 1978, Vol.15 No.6 87-90 (4 pages)
종래의 VFC type A/D Converter에서는 출력주파수가 수 100KHz까지는 linearity가 좋았으나 출역주파수가 높아 질수록 linearity error가 증가하였기 때문에 본 연구에서는 출력주파수 영역을 수 MHz까지 넓히기 위해서 tunnel diode voltage controlled oscillator를 사용하였고 입력전압과 출력주파수 사이에 linearity를 개선하기 위하여 negative feedback 회로를 사용하였다. 실험 결과에 의하면 제안된 VFC type A/D converter의 linearity는 최고 출력주파수 3.7MHz까지 0.209%이었다. -
A 10-b 500 MS/s CMOS Folding A/D Converter with a Hybrid Calibration and a Novel Digital Error Correction Logic
Jun. Joong-Won, Kim. Dae-Yun, Song. Min-Kyu 대한전자공학회 Journal of semiconductor technology and science 9 Pages
대한전자공학회 Journal of semiconductor technology and science 2012, Vol.12 No.1 1-9 (9 pages)
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Simulation of RSFQ D/A Converter
추형곤, 김규태, 강준희 한국초전도학회 Progress in superconductivity 6 Pages
한국초전도학회 Progress in superconductivity 2002, Vol.3 No.2 172-177 (6 pages)
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단순화된 S-R 래치를 이용한 6비트 CMOS 플래쉬 A/D 변환기 설계
손영준, 김원, 윤광섭, Son. Young-Jun, Kim. Won, Yoon. Kwang-Sub 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 7 Pages
한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템 2008, Vol.33 963-969 (7 pages)
적용될 수 있는 6비트 100MHz 플래쉬 A/D 변환기를 설계하였다. 제안하는 플래쉬 A/D 변환기는 해상도가 1비트씩 증가함에 따라 2배수로 증가하는 S-R 래치 회로를 단순화하여 집적화 하였다. 기존 NAND 기반의 S-R 래치 회로에 사용되던 8개의 MOS 트랜지스터 숫자를 6개로 줄였으며, 비교단의 동적 소비전력을 최대 12.5%까지 감소되도록 설계하였다. 설계된 A/D 변환기는 $0.18{mu}m$ CMOS n-well 1-poly 6-metal 공정을 사용하여 제작되었고, 전원 전압 1.8V, 샘플링 주파수 100MHz에서의 전력소모는 282mW이다. 입력 주파수 1.6MHz,... -
동기화 기능을 가지는 오차보정회로를 이용한 6비트 800MS/s CMOS A/D 변환기 설계
김원, 선종국, 윤광섭, Kim. Won, Seon. Jong-Kug, Yoon. Kwang-Sub 한국통신학회 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신 9 Pages
한국통신학회 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신 2010, Vol.35 504-512 (9 pages)
수 있는 6비트 800MS/s 플래쉬 A/D 변환기를 설계하였다. 기존의 A/D 변환기에서 서로 독립적으로 사용되던 오차보정회로단과 동기화단을 하나의 회로로 간소화 시켜서, 하드웨어에 대한 부담을 감소시켰다. 제안한 오차보정회로는 기존의 오차보정회로보다 MOS 트랜지스터의 수를 5개 감소시킬 수 있으며, 오차보정회로 한 개당 면적은 9% 정도 감소하게 된다. 설계된 A/D 변환기는 $0.18{mu}m$ CMOS 1-poly 6-metal 공정으로 제작되었으며 측정 결과 입력 범위 0.8Vpp, 1.8V의 전원 전압에서 182mW의 전력 소모를 나타내었다. 800MS/s의... -
광대역 종합 통신망 응용을 위한 8b 52 MHz CMOS 서브레인징 A/D 변환기 설계
황성욱, 이승훈, Hwang. Sung-Wook, Lee. Seung-Hoon 한국전기전자학회 전기전자학회논문지 7 Pages
한국전기전자학회 전기전자학회논문지 1998, Vol.2 No.2 309-315 (7 pages)
본 논문에서는 광대역 종합 통신망 응용을 위한 8b 52 MHz CMOS 서브레인징 (subranging) A/D 변환기 (analog-to-digital converter : ADC)를 제안한다. 제안된 A/D 변환기는 새로운 방식의 동작 순서 기법을 사용하여 기존의 이중 채널 서브레인징 A/D 변환기 동작에 존재하는 홀딩 시간 (holding time)을 제거함으로써 신호 처리 속도 (throughput rate)를 50 % 향상시켰다. 또한, 하위 비트 A/D 변환기에서의 잔류 전압처리에 인터폴레이션 (interpolation) 기법을 이용하여 A/D 변환기의 비교기에 사용되는 프리앰프의 수를 50 %... -
HDTV 응용을 위한 3V 10b 33MHz 저전력 CMOS A/D 변환기
이강진, 이승훈, Lee. Kang-Jin, Lee. Seung-Hoon 한국전기전자학회 전기전자학회논문지 7 Pages
한국전기전자학회 전기전자학회논문지 1998, Vol.2 No.2 278-284 (7 pages)
CMOS A/D 변환기 (analog-to-digital converter : ADC) 회로를 제안한다. 제안된 ADC의 전체 구조는 응용되는 시스템의 속도와 해상도 등의 사양을 고려하여 다단 파이프라인 구조가 적용되었다. 본 시스템이 갖는 회로적 특성은 다음과 같이 요약할 수 있다. 첫째, 전원전압의 변화에도 일정한 시스템 성능을 얻을 수 있는 바이어스 회로의 선택적 채널길이 조정기법을 제안한다. 둘째, 고속 2단 증폭기의 전력소모를 줄이기 위하여 증폭기가 사용되지 않는 동안 동작 전류 공급을 줄이는 전력소모 최적화 기법을 사용한다. 넷째, 다단... -
낮은 DNL 특성을 가진 8b 2단 Folding A/D 변환기
최지원, 도잔그엉, 염창윤, 이형규, 김경원, 김남수, Cui. Zhi-Yuan, Cuong. Do-Danh, Yeom. Chang-Yoon, Lee. Hyung-Gyoo, Kim. Kyoung-Won, Kim. Nam-Soo 한국전기전자재료학회 전기전자재료학회논문지 5 Pages
한국전기전자재료학회 전기전자재료학회논문지 2008, Vol.21 No.5 421-425 (5 pages)
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2개의 밑수를 이용한 Flash A/D 변환기
김종수, 김만호, 장은화, Kim. Jong-Soo, Kim. Man-Ho, Jang. Eun-Hwa 한국신호처리시스템학회 信號處理·시스템學會 論文誌 8 Pages
한국신호처리시스템학회 信號處理·시스템學會 論文誌 2008, Vol.9 No.1 54-61 (8 pages)
Number System(DBNS)방법이다. 전압은 기존의 이진수를 표시하는 방법과 동일하지만, 밑수로 2와 3의 두개를 동시에 사용하여 합의 형태로 표현하는 방법이다. DBNS 표현법은 곱셈기와 가산기를 이용하지 않고 연산을 좌우로 이동하여 연산을 신속히 처리할 수 있다. 디지털 신호처리에서 사용하는 DBNS는 합의 수가 적도록 Canonical 표현을 구하는 알고리즘을 사용하지만, A/D 변환기에서는 Fan-In 문제가 발생하여 균일한 분포를 이루도록 하는 새로운 알고리즘을 개발하였다. HSPICE를 이용한 ADC의 시뮬레이션 결과 0.18um 공정에서... -
12-bit 파이프라인 BiCMOS를 사용한 A/D 변환기의 설계
김현호, 이천희 한국시뮬레이션학회 한국시뮬레이션학회논문지 13 Pages
한국시뮬레이션학회 한국시뮬레이션학회논문지 2002, Vol.11 No.2 17-29 (13 pages)
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전자식 셔터와 A/D 변환기가 내장된 CMOS 능동 픽셀 센서
윤형준, 박재현, 서상호, 이성호, 도미영, 최평, 신장규, Yoon. Hyung-June, Park. Jae-Hyoun, Seo. Sang-Ho, Lee. Sung-Ho, Do. Mi-Young, Choi. Pyung, Shin. Jang-Kyoo 한국센서학회 센서학회지 6 Pages
한국센서학회 센서학회지 2005, Vol.14 No.4 272-277 (6 pages)
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스트레인 게이지 계측용 차동 증폭기와 A/D 변환기를 이용한 트러스 구조물의 내력 측정 장치 설계
백태현, 이병희, Baek. Tae-Hyun, Lee. Byung-Hee 한국비파괴검사학회 비파괴검사학회지 8 Pages
한국비파괴검사학회 비파괴검사학회지 2008, Vol.28 No.2 217-224 (8 pages)
수 있어야 한다. 본 논문에서는 트러스 구조물의 힘을 기본역학에서 예측되는 오차범위 이내로 실험법으로 측정할 수 있는 기구설계 방법을 제시하였다. 상용으로 제작된 재래식 변형률 측정 장치는 고가이고 복잡하므로 구조를 이해하기가 어려우므로 본 측정기구에서는 휘트스톤브리지 회로를 적용, 스트레인 게이지 및 A/D 변환기 조립하여 하중과 변형률을 쉽게 측정할 수 있도록 하였다. 제작된 기구를 이용하여 구조물에 하중을 가하여 변형률을 측정하였으며, 측정결과를 이론적으로 예측한 값과 비교하여 실용성을 입증하였다. 이...