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InSb MIS구조에서의 계면의 전기적 특성 평가
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  • InSb MIS구조에서의 계면의 전기적 특성 평가
저자명
이재곤,최시영,Lee. Jae-Gon,Choi. Sie-Young
간행물명
센서학회지
권/호정보
1996년|5권 6호|pp.60-67 (8 pages)
발행정보
한국센서학회
파일정보
정기간행물|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

저온 remote PECVD $SiO_{2}$막을 이용하여 제조된 InSb MIS구조에서의 계면의 전기적 특성에 대하여 연구하였다. $105^{circ}C$에서 증착시킨 $SiO_{2}$막을 이용한 MIS구조의 중간 에너지 대역폭에서의 계면상태밀도가 $1{sim}2{ imes}10^{11};cm^{-2}eV^{-1}$으로 평가되었다. 그러나, $105^{circ}C$이상의 고온에서 제조된 MIS소자의 계면에는 다량의 계면준위 및 트랩 준위가 존재하였다. G-V측정으로부터 계산된 계면준위들의 시상수는 $10^{-4}{sim}10^{-5};sec$였으며, 증착온도가 증가할수록 트랩밀도가 증가하여 C-V특성곡선의 이력특성이 증대되었다.

기타언어초록

The interfacial electrical properties of InSb MIS structure with low temperature remote PECVD $SiO_{2}$ have been characterized. The interlace-state density at mid-bandgap of the MIS structure was about $1{sim}2{ imes}10^{11};cm^{-2}eV^{-1}$, when the $SiO_{2}$ film was deposited at $105^{circ}C$. However, large amount of interlace states and trap states were observed in the MIS structure fabricated at temperatures above $105^{circ}C$. The time constant of $10^{-4}{sim}10^{-5};sec$ of interface states was extracted from G- V measurement. As the deposition temperature increased, the hysteresis of C- V curves were increased due to the high trap density.