기관회원 [로그인]
소속기관에서 받은 아이디, 비밀번호를 입력해 주세요.
개인회원 [로그인]

비회원 구매시 입력하신 핸드폰번호를 입력해 주세요.
본인 인증 후 구매내역을 확인하실 수 있습니다.

회원가입
서지반출
반도체 칩 접착 계면에 존재하는 모서리 균열 거동에 대한 점탄성 해석
[STEP1]서지반출 형식 선택
파일형식
@
서지도구
SNS
기타
[STEP2]서지반출 정보 선택
  • 제목
  • URL
돌아가기
확인
취소
  • 반도체 칩 접착 계면에 존재하는 모서리 균열 거동에 대한 점탄성 해석
저자명
이상순
간행물명
한국전산구조공학회논문집
권/호정보
2001년|14권 3호|pp.309-315 (7 pages)
발행정보
한국전산구조공학회
파일정보
정기간행물|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
서지반출

기타언어초록

탄성 반도체 칩과 점탄성 접착제층의 계면에 존재하는 모서리 균열에 대한 응력확대계수를 조사하였다. 이러한 균열들은 자유 경계면 부근에 존재하는 응력 특이성으로 인해 발생할 수 있다. 계면 응력상태를 해석하기 위해서 시간 영역 경계요소법이 사용되었다. 작은 크기의 모서리 균열에 대한 응력확대계수가 계산되었다. 점탄성 이완으로 인해 응력확대계수의 크기는 시간이 경과함에 따라 작아진다.

기타언어초록

The Stress intensity factors for edge cracks located at the bonding interface between the elastic semiconductor chip and the viscoelastic adhesive layer have been investigated. Such cracks might be generated due to stress singularity in the vicinity of the free surface. The domain boundary element method(BEM) has been employed to investigate the behavior of interface stresses. The overall stress intensity factor for the case of a small interfacial edge crack has been computed. The magnitude of stress intensity factors decrease with time due to viscoelastic relaxation.