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Lowering Error Floor of LDPC Codes Using an Improved Parallel WBF Algorithm
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  • Lowering Error Floor of LDPC Codes Using an Improved Parallel WBF Algorithm
  • Lowering Error Floor of LDPC Codes Using an Improved Parallel WBF Algorithm
저자명
Ma. Kexiang,Li. Yongzhao,Zhu. Caizhi,Zhang. Hailin,Zhang. Yuming
간행물명
ETRI journal
권/호정보
2014년|36권 1호|pp.171-174 (4 pages)
발행정보
한국전자통신연구원
파일정보
정기간행물|ENG|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

In weighted bit-flipping-based algorithms for low-density parity-check (LDPC) codes, due to the existence of overconfident incorrectly received bits, the metric values of the corresponding bits will always be wrong in the decoding process. Since these bits cannot be flipped, decoding failure results. To solve this problem, an improved parallel weighted bit flipping algorithm is proposed. Specifically, a reliability-saturation strategy is adopted to increase the flipping probability of the overconfident incorrectly received bits. Simulation results show that the error floor of LDPC codes is greatly lowered.