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21.

하우스킵핑 A/D 변환기의 테스트 알고리즘과 측정

박용수, 유흥균 한국반도체및디스플레이장비학회 반도체및디스플레이장비학회지 9 Pages

한국반도체및디스플레이장비학회 반도체및디스플레이장비학회지 2004, Vol.3 No.4 19-27 (9 pages)

박용수, 유흥균 저

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22.

1mW의 전력소모를 갖는 8-bit 100KSPS Cyclic 구조의 CMOS A/D 변환기

이정은, 송민규, Lee. Jung-Eun, Song. Min-Kyu 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 7 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1999, No.0 13-19 (7 pages)

이정은, 송민규, Lee. Jung-Eun, Song. Min-Kyu 저

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본 논문에서는 1mW의 낮은 전력소모를 갖는 8-bit 100KSPS CMOS A/D 변환기를 설계, 제작하였다. Cyclic 구조를 갖는 A/D 변환기에서 발생하는 연산증폭기의 시스템적인 offset 전압을 효과적으로 감소시키기 위해, 새로운 시스템적인 offset 전압 제거 기술을 제안하였다. 또한 기존 Gain 증폭기에서 발생하는 오차를 감소시키기 위해 완전 차동 구조의 Gain 증폭기를 설계하였다. 제안된 A/D 변환기는 $0.6{mu}m$ single-poly triple-metal n-well CMOS 공정을 사용하여 제작되었으며, +3V 단일 공급전압에서 DNL과 INL은 ${pm}1LSB$...
23.

전류예측기를 이용한 10비트 저전력 전류구동 CMOS A/D 변환기 설계

심성훈, 권용복, 윤광섭 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1998, No.0 22-29 (8 pages)

심성훈, 권용복, 윤광섭 저

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CMOS A/D 변환기를 설계하였다. 전류예측기와 모듈형 기준 전류원을 사용함으로써 2단 플래시구조를 갖는 A/D 변환기에 비해 비교기와 기준전류원의 개수를 줄일 수 있게 되었고, 따라서 설계된 A/D변환기의 저전력 동작이 가능하였다. 설계된 10비트 저전력 전류구동 CMOS A/D 변환기는 0.6㎛ n-well single-poly triple metal CMOS 공정을 사용하여 제작되었다. +5V 단일 공급전압하에서 동작할 때 측정된 전력소모는 94.4mW이며, 아날로그 입력 전류범위는 16㎂에서 528㎂로 측정되었으며, INL과 DNL은 각각 ±1LSB, ±0.5LSB이하로...
24.

8비트 저전력 고속 전류구동 폴딩.인터폴레이션 CMOS A/D 변환기 설계

김경민, 윤황섭 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 13 Pages

대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1997, No.0 58-70 (13 pages)

김경민, 윤황섭 저

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25.

입력전압범위 감지회로를 이용한 6비트 250MS/s CMOS A/D 변환기 설계

김원, 선종국, 정학진, 박리민, 윤광섭, Kim. Won, Seon. Jong-Kug, Jung. Hak-Jin, Piao. Li-Min, Yoon. Kwang-Sub 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2010, Vol.47 No.5 16-23 (8 pages)

김원, 선종국, 정학진, 박리민, 윤광섭, Kim. Won, Seon. Jong-Kug, Jung. Hak-Jin, Piao. Li-Min, Yoon. Kwang-Sub 저

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6비트 250MS/s 플래쉬 A/D 변환기를 설계하였다. 제안하는 플래쉬 A/D 변환기는 기준 저항열에 입력전압범위 감지회로를 사용하여 비교기에서 소모하는 동적소비전력을 최소화 되게 설계하였다. 기존 플래시 A/D 변환기보다 아날로그단 소비전력은 4.3% 증가한 반면에, 디지털단 소비전력은 1/7로 감소하여 전체 소비전력은 1/2 정도로 감소하였다. 설계된 A/D 변환기는$0.18{mu}m$ CMOS 1-poly 6-metal 공정으로 제작되었으며 측정 결과 입력 범위 0.8Vpp, 1.8V의 전원 전압에서 106mW의 전력소모를 나타내었다. 250MS/s의 변환속도와...
26.

Offset Self-Calibration 기법을 적용한 1.2V 7-bit 800MSPS Folding-Interpolation A/D 변환기의 설계

김대윤, 문준호, 송민규, Kim. Dae-Yun, Moon. Jun-Ho, Song. Min-Kyu 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2010, Vol.47 No.3 18-27 (10 pages)

김대윤, 문준호, 송민규, Kim. Dae-Yun, Moon. Jun-Ho, Song. Min-Kyu 저

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본 논문에서는 offset self-calibration 기법을 적용한 7-bit 1GSPS folding-interpolation A/D 변환기를 제안한다. 제안하는 A/D 변환기는 folding rate 2, interpolation rate 8의 1+6 구조로 고속 동작에 적합하게 설계되었다. 또한 offset self-calibration 회로를 설계하여 공정 mismatch, 기생 저항, 기생 캐패시턴스 등에 의한 offset-voltage의 변화를 감소시켜 A/D 변환기의 성능 특성을 향상 시켰다. 제안하는 A/D 변환기는 1.2V 65nm 1-poly 6-metal CMOS 공정을 사용하여 설계 되었으며 유효 칩 면적은 $0.87mm^2$, 1.2V...
27.

1.8V 8-bit 500MSPS Cascaded-Folding Cascaded-Interpolation CMOS A/D 변환기의 설계

정승휘, 박재규, 황상훈, 송민규, Jung. Seung-Hwi, Park. Jae-Kyu, Hwang. Sang-Hoon, Song. Min-Kyu 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2006, Vol.43 No.5 1-10 (10 pages)

정승휘, 박재규, 황상훈, 송민규, Jung. Seung-Hwi, Park. Jae-Kyu, Hwang. Sang-Hoon, Song. Min-Kyu 저

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본 논문에서는, 1.8V 8-bit 500MSPS CMOS A/D 변환기를 제안한다. 8-bit 해상도, 고속의 샘플링과 입력 주파수, 그리고 저 전력을 구현하기 위하여 Cascaded-Folding Cascaded-Interpolation type으로 설계되었다. 또한 본 연구에서는 고속 동작의 문제점들을 해결하기 위하여 새로운 구조의 Digital Encoder, Reference Fluctuation을 보정하기 위한 회로, 비교기 자체의 Offset과 Feedthrough에 의한 오차를 최소화하기 위한 Averaging Resistor, SNR을 향상시키기 위한 Distributed Track & Hold를 설계하여 최종적으로 500MSPS의 A/D...
28.

A/D 변환기 회로에서 터미네이션 임피던스의 crosstalk에 대한 영향 분석

임한상, Lim. Han-Sang 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 2010, Vol.47 No.2 35-42 (8 pages)

임한상, Lim. Han-Sang 저

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본 논문은 A/D 변환기(Analog-to-Digital Converter) 회로에서 신호선의 터미네이션 조건이 crosstalk에 의해 왜곡되기 쉬운 특성을 가지며 동작 주파수가 높아짐에 따라 이에 대한 주의가 더욱 요구된다. 그중에서도 아날로그 신호인 입력 신호와 레퍼런스 전압 신호는 crosstalk에 의해 왜곡되기 쉬운 아날로그 신호이면서, A/D 변환 전체의 동작 성능을 좌우하는 신호들이다. 이 두 신호들은 각각의 회로 구성에 따라 독특한 터미네이션 조건을 가지므로 본 논문에서는 주파수 영역에서 임피던스 불일치 조건을 고려한 crosstalk를...
29.

높은 SFDR을 갖는 2.5 V 10b 120 MSample/s CMOS 파이프라인 A/D 변환기

박종범, 유상민, 양희석, 지용, 이승훈, Park. Jong-Bum, Yoo. Sang-Min, Yang. Hee-Suk, Jee. Yong, Lee. Seung-Hoon 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 9 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 2002, Vol.39 No.4 16-24 (9 pages)

박종범, 유상민, 양희석, 지용, 이승훈, Park. Jong-Bum, Yoo. Sang-Min, Yang. Hee-Suk, Jee. Yong, Lee. Seung-Hoon 저

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높은 해상도와 고속 신호 샘플링을 위해 병합 캐패시터 스위칭(merged-capacitor switching：MCS) 기법을 적용한 10b 120 MSample/s CMOS 파이프라인 A/D 변환기(analog-to- digital converter：ADC) 회로를 제안한다. 제안하는 ADC의 전체 구조는 응용되는 시스템의 속도, 해상도 및 면적 등의 사양을 고려하여 다단 파이프라인 구조를 사용하였고, MDAC(multiplying digital-to- analog converter)의 캐패시터 수를 50 %로 줄임으로써 해상도와 동작 속도를 동시에 크게 향상시킬 수 있는 MCS 기법을 적용하였다. 제안하는 ADC는 0.25...
30.

CMOS A/D 변환기의 샘플링 속도 및 해상도 향상을 위한 병합 캐패시터 스위칭 기법

유상민, 전영득, 이승훈, Yu. Sang-Min, Jeon. Yeong-Deuk, Lee. Seung-Hun 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 7 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 2000, Vol.37 No.6 35-41 (7 pages)

유상민, 전영득, 이승훈, Yu. Sang-Min, Jeon. Yeong-Deuk, Lee. Seung-Hun 저

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본 논문에서는 전형적인 파이프라인 CMOS A/D 변환기(ADC)의 신호 처리 속도와 해상도를 향상시키기 위해 병합 캐패시터 스위칭(merged-capacitor switching MCS)기법을 제안한다. 제안하는 MCS 기법은 기존의 ADC에 사용되는 multiplying digital-to-analog converter(MDAC)의 캐패시터 수를 50%로 줄임으로써, 부하 캐패시터의 감소로 인해 샘플링 속도를 크게 향상시킬 수 있다. 또한, MCS 기법에서 줄어든 캐패시터 수에 해당하는 크기만큼 각 캐패시터 크기를 2배 증가시킬 경우, 전력 소모 및 샘플링 속도의 감소없이 캐패시터...

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