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Design of a 6-bit 500MS/s CMOS A/D Converter with Comparator-Based Input Voltage Range Detection Circuit
시대, 이상민, 윤광섭, Dai. Shi, Lee. Sang Min, Yoon. Kwang Sub 한국통신학회 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신 7 Pages
한국통신학회 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신 2013, No.0 303-309 (7 pages)
입력 전압 범위 감지 회로를 이용해서 저전력 6비트 플래시 500Ms/s ADC를 설계하였다. 입력 전압 범위 감지 회로는 변환기내 모든 비교기들 중에서 25%만 동작시키고, 나머지 75%는 동작시키지 않는 방법을 채택하므로 저전력 동작을 가능하게 설계 및 제작하였다. 설계된 회로는 0.13um CMOS 공정기술을 이용해서 제작하였고, 1.2V 전원전압에서 68.8mW 전력소모, 4.9 유효 비트수, 4.75pJ/step의 평가지수가 측정되었다. -
자체보정 벡터 발생기를 이용한 7-bit 2GSPS A/D Converter의 설계
김승훈, 김대윤, 송민규, Kim. Seung-Hun, Kim. Dae-Yun, Song. Min-Kyu 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2011, Vol.48 No.4 14-23 (10 pages)
발생기(Self-Calibrated Vector Generator)를 이용한 7-bit 2GSPS folding/interpolation A/D Converter (ADC)를 제안한다. 제안하는 ADC는 2GSPS 의 고속 변환에 적합한 상위 2-bit, 하위 5-bit 인 분할구조로 설계 되었으며, 각각의 folding/interpolation rate는 4와 8로 설정되었다. 최대 1GHz의 높은 입력신호를 처리하기 위해 cascade 구조의 preprocessing block을 적용하였으며, 전압 구동 방식 interpolation 기법을 적용하여 기준전압 생성 시 발생하는 추가적인 전력소모를 최소화하였다. 또한, 새로운 개념의 자체보정 벡터... -
Interpolation 기법을 이용한 3.3V 8-bit 500MSPS Nyquist CMOS A/D Converter의 설계
김상규, 송민규 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2004, Vol.41 No.8 67-74 (8 pages)
이 논문에서는 Interpolation 구조를 이용한 3.3V 8-bit 500MSPS CMOS A/D 변환기를 설계하였다. 고속 동작의 문제를 해결하기 위해서 새로운 프리앰프, 기준 전압 흔들림을 보정하기 위한 회로, 평균화 저항을 제안하였다. 제안된 Interpolation A/D 변환기는 Track ＆ Hold, 256개의 기준전압이 있는 4단 저항열, 128개의 비교기 그리고 디지털 블록으로 구성되어 있다. 제안된 A/D 변환기는 0.35um 2-poly 4-metal N-well CMOS 공정이다. 이 A/D 변환기는 3.3V에서 440mW를 소비하며, 유효 칩 면적은 2250um x 3080um을 갖는다. -
VFC type A/D Converter에 관한 연구
김춘성, 이종각 대한전자공학회 電子工學會誌 4 Pages
대한전자공학회 電子工學會誌 1978, Vol.15 No.6 87-90 (4 pages)
종래의 VFC type A/D Converter에서는 출력주파수가 수 100KHz까지는 linearity가 좋았으나 출역주파수가 높아 질수록 linearity error가 증가하였기 때문에 본 연구에서는 출력주파수 영역을 수 MHz까지 넓히기 위해서 tunnel diode voltage controlled oscillator를 사용하였고 입력전압과 출력주파수 사이에 linearity를 개선하기 위하여 negative feedback 회로를 사용하였다. 실험 결과에 의하면 제안된 VFC type A/D converter의 linearity는 최고 출력주파수 3.7MHz까지 0.209%이었다. -
A 10-b 500 MS/s CMOS Folding A/D Converter with a Hybrid Calibration and a Novel Digital Error Correction Logic
Jun. Joong-Won, Kim. Dae-Yun, Song. Min-Kyu 대한전자공학회 Journal of semiconductor technology and science 9 Pages
대한전자공학회 Journal of semiconductor technology and science 2012, Vol.12 No.1 1-9 (9 pages)
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Simulation of RSFQ D/A Converter
추형곤, 김규태, 강준희 한국초전도학회 Progress in superconductivity 6 Pages
한국초전도학회 Progress in superconductivity 2002, Vol.3 No.2 172-177 (6 pages)