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An On-chip Multiprocessor Miroprocessor with Shared MMU and Cache
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  • An On-chip Multiprocessor Miroprocessor with Shared MMU and Cache
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저자명
Lee. Yong-Hwan,Jeong. Woo-Kyeong,An. Sang-Jun,Lee. Yong-Surk
간행물명
Journal of electrical engineering and information science
권/호정보
1997년|2권 4호|pp.1-7 (7 pages)
발행정보
한국정보과학회
파일정보
정기간행물|ENG|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

A multiprocessor microprocessor named SMPC(scaleable multiprocessor chip) that contains tow IU (integer unit) is presented in this paper. It can execute multiple instructions from several tasks exploiting task-level parallelism that is free from instruction dependencies, and provide high performance and throughput on both single program and multiprogramming environments. the IU is a 32-bit scalar processor expecially designed to boost up the performance of string manipulations which are frequently used in RDBMS(relational data base management system) applications. A memory management unit and a data cache shared by two IUs improve the performance and reduce the chip area required. ETH SMPC is implemented in VLSI circuit by custom design and automated design tools.